FPGA Design Engineer: RTL, IP Integration

12 ore fa

Gallicano nel Lazio, Lazio, Italia Dedagroup Tempo pieno 45.000 € - 65.000 € Contratto

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Progetti in infrastrutture IP, sistemi embedded e reti complesse richiedono competenze in HDL e integrazione IP, anche su SoC.

Responsabilità includono scrittura RTL, integrazione IP, test su scheda e redazione di documentazione tecnica. xbvzest

Laurea in ingegneria, conoscenza di VHDL/Verilog e strumenti di sviluppo come Quartus o Vivado sono fondamentali.